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AMD 周一晚些时候宣告已取得其首款 2nm 级芯片，这是其第 6 代 EPYC “Venice”处理器的中心杂乱芯片裸片 (core complex die （CPU）)，该处理器估计将于下一年推出。
“Venice“ 中心复合芯片是业界首款选用台积电 N2 工艺技能进行流片的高功能核算（HPC）中央处理器规划，突显了 AMD 急进的开展路线图以及台积电出产节点的成熟度。
AMD 的第六代霄龙 Venice 处理器估计将根据该公司的 Zen 6 微架构，并有望在 2026 年的某个时刻推出。这款 CPU 将依靠台积电 N2（2 纳米级）制作工艺出产的中心复合芯片，因而 AMD 公司现在拿到第一批从工厂产出的 Venice 中心复合芯片也在情理之中。
现在，AMD 并未评论其霄龙 Venice 处理器或中心复合芯片的细节，不过该公司的新闻稿称芯片已完结流片并成功发起，这在某种程度上预示着该中心复合芯片已成功通电，并经过了基本功能测验与验证。
AMD 首席执行官苏姿丰博士表明：“多年来，台积电一直是咱们的要害协作伙伴，咱们与他们的研制和制作团队的深度协作，使 AMD 能够继续推出引领职业的产品，不断打破高功能核算的极限。作为台积电 N2 工艺以及台积电亚利桑那州 21 号工厂的首要高功能核算客户，这很好地展现了咱们怎么严密协作以推进立异，并交给能够为未来核算供给动力的先进技能。”
台积电的 N2 工艺是这家晶圆代工厂首款选用盘绕栅极（GAA）纳米片晶体管的工艺技能。该公司估计，与上一代 N3（3 纳米级）工艺比较，其制作技能将完成功耗下降 24% 至 35%，或许在相同电压下功能进步 15%，一同晶体管密度进步 1.15 倍。这些进步首要得益于新式晶体管以及 N2工艺灵敏（NanoFlex）规划技能协同优化结构。
在 AMD 发布这一音讯之前，其首要竞赛对手英特尔推延了选用 18A 制作技能出产的下一代至强 “Clearwater Forest”处理器的发布时刻，新的发布时刻推延到了下一年上半年（英特尔的 18A 技能旨在与台积电的 N2 工艺竞赛）。
别的，AMD 还宣告，其已成功验证了由台积电在美国亚利桑那州凤凰城的Feb 21工厂出产的第五代霄龙处理器的芯片。因而，该公司现在的一些第五代霄龙 CPU 现在能够在美国出产了。
台积电首席执行官兼董事长魏哲家博士表明：“咱们很骄傲 AMD 能是咱们先进 2 纳米（N2）工艺技能和台积电亚利桑那州工厂的首要高功能核算客户。经过一同尽力，咱们正在推进严重的技能晋级，为高功能芯片带来更好的功能、更高的动力功率和更高的良品率。咱们等待继续与 AMD 严密协作，敞开核算范畴的新时代。”
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